FPGA 状态机赋值 —— 三段式结构
FPGA状态机赋值核心原则是时序逻辑用非阻塞赋值 (<=)，组合逻辑用阻塞赋值 (=)。通常采用三段式结构：第一段时序逻辑负责状态寄存器更新，第二段组合逻辑负责状态跳转条件判断，第三段逻辑负责输出（建议时序输出以消除毛刺）。
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